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西部數(shù)據(jù)（Western Digital）已在其SweRV微控制器CPU 產(chǎn)品組合中增加了兩個(gè)新的處理器內(nèi)核-SweRV Core EH2和SweRV Core EL2 。并且，與過(guò)去的部分保持兼容，該公司已免費(fèi)向行業(yè)提供其寄存器級(jí)（RTL）設(shè)計(jì)，可已完全免費(fèi)下載使用（文末可下載）。（注：該設(shè)計(jì)是在Apache 2.0許可下授權(quán)的，Apache 2.0許可是一個(gè)非常寬松的許可，允許核心免費(fèi)使用，無(wú)論是否進(jìn)行了修改，許可證的要求相當(dāng)少，除了要求正確的署名外，唯一值得注意的限制是第三方開(kāi)發(fā)者不能使用西部數(shù)據(jù)的品牌來(lái)標(biāo)記他們的產(chǎn)品。）。此外，該公司還推出了第一個(gè)基于以太網(wǎng)協(xié)議的OmniXtend緩存一致性存儲(chǔ)器的硬件參考設(shè)計(jì)，并將該架構(gòu)的管理和支持轉(zhuǎn)移給了Chips Alliance。 

SweRV內(nèi)核EH2是設(shè)計(jì)用于微控制器的32位有序內(nèi)核。它使用9級(jí)流水線的2路超標(biāo)量設(shè)計(jì)和2路同時(shí)多線程功能。從本質(zhì)上講，EH2是去年推出的EH1的性能增強(qiáng)版本，支持SMT，旨在使用TSMC的16 nm FinFET制造技術(shù)制造，以實(shí)現(xiàn)最大的PPA（功率，性能，面積）效率。EH2內(nèi)核應(yīng)提供6.3 CoreMark/MHz（基于Western Digital的仿真結(jié)果），高于EH1情況下的4.9 CoreMark/MHz，使用上述工藝生產(chǎn)時(shí)，其尺寸僅為0.067mm²（相比之下，采用28nm的EH1尺寸為為0.11mm²）。SweRV Core EH2可直接采用與EH1相同的應(yīng)用程序（例如SSD控制器）。

相比之下，SweRV Core EL2的目的最小化，因?yàn)樗鼘⒈挥脕?lái)取代控制器soc中必須盡可能小的順序邏輯和狀態(tài)機(jī)。EL2是一個(gè)32位有序內(nèi)核，具有1路標(biāo)量設(shè)計(jì)和四級(jí)流水線。Western Digital期望內(nèi)核為0.023mm²大，并提供約3.6 CoreMarks/MHz的性能。

Western Digital表示，其所有三個(gè)SweRV內(nèi)核都將在不久的將來(lái)用于其各種產(chǎn)品中。同時(shí)，將這些核心免費(fèi)分享給其更多的人，以便更加豐富RISC-V的生態(tài)系統(tǒng)。

說(shuō)到生態(tài)系統(tǒng)，西部數(shù)據(jù)發(fā)布了其第一款基于以太網(wǎng)兼容架構(gòu)協(xié)議的OmniXtend緩存一致性存儲(chǔ)器的硬件參考設(shè)計(jì)使芯片的開(kāi)發(fā)人員能夠在他們的設(shè)計(jì)中實(shí)現(xiàn)它。最初，該體系結(jié)構(gòu)可用于將持久性內(nèi)存連接到CPU，但也可以集成到GPU，FPGA和機(jī)器學(xué)習(xí)加速器等組件中。

說(shuō)到生態(tài)系統(tǒng)，西部數(shù)字發(fā)不了第一個(gè)硬件參考設(shè)計(jì)，它的OmniXtend緩存相干內(nèi)存基于以太網(wǎng)兼容的fabric協(xié)議，使芯片的開(kāi)發(fā)人員能夠在他們的設(shè)計(jì)中實(shí)現(xiàn)它。該參考設(shè)計(jì)將可從Chips Alliance獲得，后者還將處理OmniXtend協(xié)議的進(jìn)一步開(kāi)發(fā)。

西部數(shù)據(jù)的這三款RISC-V內(nèi)核采用了SystemVerilog 實(shí)現(xiàn)，目前完整設(shè)計(jì)代碼已公開(kāi)，已經(jīng)可以免費(fèi)下載，下載方法：

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