JESD204B FPGA調(diào)試軟件加快高速設(shè)計(jì)速度
2013-10-17 14:19:33 本站原創(chuàng)能信號(hào)處理解決方案供應(yīng)商，今天發(fā)布了一款基于FPGA的參考設(shè)計(jì) 及配套軟件和HDL代碼，該參考設(shè)計(jì)可降低集成JESD204B兼容轉(zhuǎn)換器的高速系統(tǒng)的設(shè)計(jì)風(fēng)險(xiǎn)。該軟件為JESD204B Xilinx收發(fā)器調(diào)試工具，可支持312.5Mbps至12.5Gbps的 JESD204B數(shù)據(jù)轉(zhuǎn)換器 至FPGA串行數(shù)據(jù)接口和Xilinx® Inc., 7系列FPGA及Zynq®-7000全可編程SoC。它隨ADI轉(zhuǎn)換器免費(fèi)提供，通過提供片內(nèi)二維統(tǒng)計(jì)眼圖掃描，幫助雷達(dá)陣列、軟件定義無線電以及其他高速系統(tǒng)的設(shè)計(jì)人員更快地驗(yàn)證采用千兆收發(fā)器的JESD204B數(shù)據(jù)轉(zhuǎn)換器至FPGA設(shè)計(jì)的信號(hào)完整性。
JESD204B FPGA調(diào)試軟件加快高速設(shè)計(jì)速度
Xilinx高速I/O產(chǎn)品經(jīng)理Revathi Narayanan表示：“ADI的JESD204B Xilinx收發(fā)器調(diào)試工具提供了片內(nèi)眼圖掃描功能，能以統(tǒng)計(jì)手段確定FPGA內(nèi)部信號(hào)的完整性，是測(cè)試和測(cè)量流程的有效補(bǔ)充。其他技術(shù)均針對(duì)FPGA封裝的外部，并在Xilinx自動(dòng)增益控制和均衡器模塊處理之前采集信號(hào)，而ADI則利用Xilinx收發(fā)器片內(nèi)眼圖掃描功能，使開發(fā)人員可以監(jiān)控FPGA內(nèi)部JESD204B鏈路上的信號(hào)完整性和設(shè)計(jì)裕量，從而獲得更加準(zhǔn)確的結(jié)果。”
ADI的參考設(shè)計(jì)直接從7系列IBERT內(nèi)核中的片內(nèi)Rx裕量分析功能收集數(shù)據(jù)，并在FPGA或者ARM®雙核Cortex™-A9 MPCore™處理器之一的內(nèi)部管理本地?cái)?shù)據(jù)，在HDMI顯示器上顯示數(shù)據(jù)，或者通過以太網(wǎng)將數(shù)據(jù)送至遠(yuǎn)程監(jiān)控站。一般地，其他掃描工具在片外測(cè)量信號(hào)，需要使用昂貴的測(cè)試和測(cè)量設(shè)備，或者需要通過JTAG傳回?cái)?shù)據(jù)，以便在實(shí)驗(yàn)室的主機(jī)/開發(fā)電腦上查看。
“實(shí)時(shí)”數(shù)據(jù)采集功能可監(jiān)控設(shè)備健康狀態(tài)
替代型掃描工具一般通過生成偽隨機(jī)位流(PRBS)的方式來測(cè)量高速數(shù)據(jù)鏈路，而系統(tǒng)會(huì)在封閉開發(fā)環(huán)境中校驗(yàn)該偽隨機(jī)位流的位級(jí)正確性。這種方式并不描述設(shè)計(jì)的實(shí)際表現(xiàn)，也不說明設(shè)計(jì)是否可能瀕臨失敗。ADI的參考設(shè)計(jì)使用流向FPGA的真實(shí)JESD204B串行數(shù)據(jù)來測(cè)量鏈路的穩(wěn)健性。通過這種利用“實(shí)時(shí)”數(shù)據(jù)的方式，即使已在現(xiàn)場(chǎng)部署設(shè)計(jì)之后，也可監(jiān)控信號(hào)的保真度，從而在產(chǎn)品的壽命周期內(nèi)進(jìn)行實(shí)時(shí)、預(yù)見性維護(hù)。
報(bào)價(jià)與供貨
| 產(chǎn)品 | 供貨 | 報(bào)價(jià) |
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