Synopsys宣布即刻提供多協(xié)議DesignWare Enterprise 12G PHY IP
2014-02-19 20:52:23 本站原創(chuàng)Synopsys日前宣布：其多協(xié)議DesignWare® Enterprise 12G PHY IP正式上市，該物理層知識產(chǎn)權(quán)（PHY IP）將使多樣化的高端網(wǎng)絡(luò)和計算應(yīng)用在功耗降低的同時提升了性能。DesignWare Enterprise 12G PHY是專門為應(yīng)對設(shè)計師們所面臨的不斷增長的性能/功耗平衡挑戰(zhàn)而設(shè)計，它使設(shè)計師能夠輕松地將各種企業(yè)級通信協(xié)議集成到他們的系統(tǒng)級芯片（SoC）上，包括PCI Express 3.0、SATA 6G、10GBASE-KR、10GBASE-KX4 (XAUI)、1000BASE-KX、CEI-6G/11G、SGMII、QSGMII、SFF-8431、CPRI、OBSAI和JESD204B等，，而使這些SoC具有比競爭性解決方案更高的性能同時功耗降低多達20%。
DesignWare Enterprise 12G PHY包括架構(gòu)性的創(chuàng)新，以明顯地降低企業(yè)應(yīng)用SoC的功耗。這種高性能模擬前端集成了在工作和待機兩種運行模式中的省電功能。該混合發(fā)送驅(qū)動器支持低功耗電壓模式和高擺幅電流模式，以及其它的可降低功耗的特性，如在驅(qū)動和決策反饋均衡（DFE）旁路模式下的L1子狀態(tài)、可選的I/ O電源。
高性能的DesignWare Enterprise 12G PHY支持從芯片到芯片、背板和端口側(cè)接口來確保復(fù)雜的系統(tǒng)集成。靈活的時鐘倍增器單元（CMU）包括多個鎖相環(huán)（PLL），以便在包括老式系統(tǒng)這樣要求最嚴(yán)苛的應(yīng)用中，穿過長而有損耗的背板傳輸從1.25 Gbps到12.5 Gbps的高質(zhì)量數(shù)據(jù)。該模擬前端包括5級DFE（5-tap DFE）、連續(xù)時間線性均衡（CTLE）和前饋均衡（FFE），并帶有先進的算法用于啟動和任務(wù)模式適應(yīng)，以在高吞吐量通信通道中提升信號完整性。其帶有諸如參考時鐘轉(zhuǎn)發(fā)和PCI Express聚集及二分等先進功能的多通道架構(gòu)，為設(shè)計師提供了一種用于各種高速SoC的靈活的、可擴展的PHY IP解決方案。
“作為一家加入PCI-SIG超過10年的成員，Synopsys在開發(fā)PCIe 技術(shù)方面已經(jīng)扮演了一種重要的角色，”PCI-SIG主席兼總裁Al Yanes表示：“其對PCIe 3.0架構(gòu)的支持有助于使PCI Express生態(tài)系統(tǒng)的不斷成功。”
“根據(jù)數(shù)據(jù)中心和云處計算的最新趨勢，在諸如軟件定義聯(lián)網(wǎng)和低功耗微服務(wù)器中，系統(tǒng)架構(gòu)師正越來越多地在單個SoC中實現(xiàn)多個高帶寬通訊協(xié)議，”Synopsys公司IP和系統(tǒng)市場副總裁John Koeter評論道：“通過在我們多樣化的數(shù)據(jù)中心IP產(chǎn)品組合中增加DesignWare Enterprise 12G PHY IP，我們能夠幫助設(shè)計師更好地處理全新云計算架構(gòu)中的性能和功耗問題。”
供貨
采用28納米工藝技術(shù)的DesignWare Enterprise 12G PHY IP已經(jīng)開始供貨，采用14/16納米FinFET工藝技術(shù)的IP正在開發(fā)。Synopsys面向數(shù)據(jù)中心的DesignWare IP產(chǎn)品組合還包括用于40G/10G/1G以太網(wǎng)、DDR4/3、PCI Express 3.0/2.0、USB 3.0/2.0、SATA 6G和ARM® AMBA® AXI4™和 AMBA 3連接器的解決方案，邏輯庫與嵌入式存儲器；以及Synopsys ARC®處理器，上述所有的產(chǎn)品現(xiàn)在都已可供貨。
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