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PCI-SIG花了7年時(shí)間才完成了PCIe 4.0規(guī)范，工作組表示PCIe 5.0及以后的版本更新速度將會(huì)加快。PCIe 6.0就保持了快速的制定步伐，在規(guī)范正式發(fā)布不到一年的時(shí)間內(nèi)發(fā)布了該規(guī)范的第一版草案。

PCIe 6.0的0.5版是第一個(gè)規(guī)范草案，它涵蓋了體系結(jié)構(gòu)的所有關(guān)鍵方面，并包括相關(guān)方對(duì)0.3版的反饋。0.7版被認(rèn)為是完整的草案，而0.9版是允許PCI-SIG成員審查其知識(shí)產(chǎn)權(quán)技術(shù)的最終草案。

根據(jù)官方的介紹，PCIe 6.0的帶寬將會(huì)再次翻倍，PCIe 6.0 x16的帶寬將提升至256GB/s。

PCI-SIG 在創(chuàng)建PCIe規(guī)范中有五個(gè)關(guān)鍵步驟：

• 版本0.3被視為概念制定，概述了該技術(shù)的主要功能和體系結(jié)構(gòu)。在PCIe 6.0的情況下，我們談?wù)摰氖敲客ǖ浪俣?4GT / s，具有PAM-4編碼的脈沖幅度調(diào)制以及前向糾錯(cuò)（FEC）。
• 版本0.5被認(rèn)為是初稿規(guī)范，因此它涵蓋了體系結(jié)構(gòu)的所有關(guān)鍵方面，并包括有關(guān)方面（在PCI-SIG內(nèi)）對(duì)版本0.3的反饋。該小組的成員現(xiàn)在將能夠?yàn)樵摷夹g(shù)添加新功能。
• 版本0.7被認(rèn)為是完整的草案，所定義的各級(jí)和電氣規(guī)范必須通過測試芯片進(jìn)行驗(yàn)證。在本規(guī)范的此版本發(fā)布后，不得添加任何新功能。
• 0.9版是最終草案，旨在使PCI-SIG成員可以對(duì)其技術(shù)進(jìn)行知識(shí)產(chǎn)權(quán)審查。

• 1.0版是最終版本。

發(fā)布PCIe 6.0規(guī)范的0.5版本質(zhì)上是要求PCI-SIG成員公司提交新特性的最后要求。此外，有了第一個(gè)可用的草案，公司可以開始設(shè)計(jì)測試芯片，以確保一切正常，甚至可以在商用芯片上開始初步的工作。

PCIe 6.0規(guī)范的下一個(gè)里程碑將是6月初即將召開的2020年P(guān)CI-SIG開發(fā)者大會(huì)，該小組計(jì)劃在會(huì)上深入介紹該技術(shù)的特性。