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Xilinx可重配置存儲(chǔ)加速解決方案亮相2017年閃存峰會(huì)

2017-08-15 17:03:24 未知

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All Programmable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司（Xilinx, Inc.，(NASDAQ:XLNX)）宣布，在2017 年閃存峰會(huì)上展示了可重配置存儲(chǔ)加速解決方案。通過(guò)一系列的演示和介紹，賽靈思及其生態(tài)系統(tǒng)重點(diǎn)展示了用于當(dāng)前和下一代企業(yè)和數(shù)據(jù)中心應(yīng)用的高性能存儲(chǔ)解決方案。在今年的閃存峰會(huì)上首次公開(kāi)亮相的賽靈思NVMe-over-Fabrics參考設(shè)計(jì)為設(shè)計(jì)人員提供了靈活的平臺(tái)，不僅可以幫助設(shè)計(jì)者實(shí)現(xiàn)可擴(kuò)展的存儲(chǔ)解決方案，而且還能幫助他們將定制加速功能集成到其存儲(chǔ)陣列中。該參考設(shè)計(jì)無(wú)需專用 x86 處理器或外接網(wǎng)卡，因此能開(kāi)發(fā)出高度集成、穩(wěn)健可靠的低成本解決方案。

賽靈思在展會(huì)上的演示與參與的小組討論包括

面向下一代NVMe平臺(tái)的可重配置存儲(chǔ)加速
演講者：Rakesh Cheerla，賽靈思產(chǎn)品經(jīng)理
用 FPGA 加速基于NVMe-over-Fabric 的存儲(chǔ)網(wǎng)絡(luò)
演講者：Deboleena Minz Sakalley，賽靈思高級(jí)設(shè)計(jì)工程師
用 FPGA 和一體化閃存存儲(chǔ)技術(shù)加速數(shù)據(jù)分析
演講者：HK Verma，賽靈思首席工程師

賽靈思在展會(huì)上的精彩演示：

NVMe-over-Fabric平臺(tái)

賽靈思單芯片存儲(chǔ)解決方案將NVMe-over-Fabric、目標(biāo) RDMA 卸載和處理子系統(tǒng)完美集成在一起，相對(duì)于需要外部主控芯片和網(wǎng)絡(luò)接口卡（NIC）的現(xiàn)有產(chǎn)品而言，更加省電且能提供更低時(shí)延。該 2x100Gb 以太網(wǎng)平臺(tái)能幫助客戶實(shí)現(xiàn)增值存儲(chǔ)工作負(fù)載加速如壓縮和擦寫(xiě)代碼等。

面向數(shù)據(jù)驅(qū)動(dòng)型應(yīng)用的計(jì)算存儲(chǔ)子系統(tǒng)

ScaleFlux計(jì)算存儲(chǔ)子系統(tǒng)（CSS）獨(dú)特地解決了計(jì)算和存儲(chǔ) I/O 瓶頸問(wèn)題。CSS壓縮技術(shù)能加速吞吐量實(shí)現(xiàn)數(shù)量級(jí)提升，而且不必運(yùn)行軟件解決方案需要的成本不菲的 CPU 開(kāi)銷(xiāo)，從而可以實(shí)現(xiàn)性能不減，存儲(chǔ)容量利用率最高。

支持多源閃存產(chǎn)品的的可編程控制器

Burlywood 的TrueFlash模塊化控制器架構(gòu)，不僅能加快新型 NAND 的市場(chǎng)采用進(jìn)程，同時(shí)為云端、全閃存陣列和超融合 OEM 客戶帶來(lái)突破性的成本和性能優(yōu)勢(shì)。采用賽靈思UltraScale+™ FPGA的TrueFlash，充分利用賽靈思器件的功耗、性能和成本方面的優(yōu)勢(shì)，能幫助客戶快速優(yōu)化解決方案，滿足工作負(fù)載要求，還能運(yùn)用同一控制器驗(yàn)證多種 NAND 產(chǎn)品。

包括Everspin Technologies、IntelliProp、IP-Maker、Kazan Networks、MobiVeil、PLDA和Smart IOPs 等公司在內(nèi)的賽靈思生態(tài)系統(tǒng)公司，都在其 FMS 展臺(tái)演示了各自基于賽靈思技術(shù)的產(chǎn)品。

關(guān)于NVMe-Over-Fabrics：

NVMe-Over-Fabrics（簡(jiǎn)稱 NVM-oF）參考平臺(tái)實(shí)現(xiàn)在Fidus Sidewinder卡上，支持多達(dá) 4個(gè)NVMe SSD 并采用賽靈思 ZU19EG Ultrascale+ MPSoC器件。該參考平臺(tái)配套提供所需的所有必要軟件驅(qū)動(dòng)程序。

賽靈思 ZU19EG 器件能把NVMe-oF和 ROCEv2 RDMA 協(xié)議工作解放出來(lái)，從而無(wú)需外部 CPU和外部 NIC。這種高度集成的平臺(tái)降低了存儲(chǔ)陣列控制器的構(gòu)建成本和功耗要求。