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業(yè)界最快的FPGA編譯時間
Quartus II軟件12.0保持業(yè)界最快的編譯時間，使得用戶能夠?qū)⒃O(shè)計團隊資源集中在設(shè)計創(chuàng)新上，同時提高了設(shè)計人員的效能。采用這一版本軟件，與公司以前版本軟 件相比，Stratix® V FPGA用戶編譯時間平均縮短了35%，而Cyclone® V和Arria® V FPGA用戶編譯時間平均縮短了25%。

擴展28-nm FPGA支持
Quartus II軟件12.0擴展了對28-nm FPGA的支持，包括，初次支持具有硬核雙核ARM® Cortex™-A9處理器的Altera SoC FPGA。用戶可以選擇并開始設(shè)計多種低成本、中端和高端28-nm FPGA：新支持包括：
• 對Stratix V GX和Stratix V GS產(chǎn)品器件的編程支持
o 5SGXA7、5SGXA4、5SGXA3和5SGXA5
o 5SGSD5和5SGSD4
• 對Stratix V GT FPGA的編程支持
o 5SGTC5
• 對最大的Arria V GT FPGA的器件支持
o 5AGTD7，最終引出支持
• 對Cyclone V FPGA的器件支持
o 5CEA7和5CGTD7
o 5CEA9、5CGXC9和5CGTD9
• 對Cyclone V SX SoC FPGA的編譯支持
o 5CSXFC6D6

Qsys系統(tǒng)集成工具增加了AXI-3接口支持
 對于這一版本軟件，Altera還在其Qsys系統(tǒng)集成工具中增加了對ARM AMBA® AXI™-3接口的支持，用戶能夠根據(jù)不同的標準接口，靈活的連接IP內(nèi)核和IP子系統(tǒng)。Qsys是FPGA業(yè)界首款基于芯片網(wǎng)絡(luò)(NoC)技術(shù)的系統(tǒng)集 成工具，為用戶提供高性能互聯(lián)。這一工具使用分層方法集成了IP功能和IP子系統(tǒng)，從而簡化系統(tǒng)開發(fā)。最新版具有多種使用方便的特性，提高系統(tǒng)設(shè)計人員的 自動化工作程度，簡化設(shè)計重用。www.altera.com.cn/qsys上提供了Qsys更詳細的信息。

Quartus II設(shè)計套裝的其他特性包括：
• DSP Builder 12.0新的數(shù)字信號處理(DSP)支持——通過系統(tǒng)控制臺，與MATLAB的DDR存儲器進行通信，并具有新的浮點功能，提高了設(shè)計效能，以及DSP效率。
• 經(jīng)過改進的視頻和圖像處理(VIP)套裝以及視頻接口IP——通過具有邊緣自適應(yīng)算法的Scaler II MegaCore功能以及新的Avalon-Streaming (Avalon-ST)視頻監(jiān)視和跟蹤系統(tǒng)IP內(nèi)核，簡化了視頻處理應(yīng)用的開發(fā)。
• 增強收發(fā)器設(shè)計和驗證——更新了Arria V FPGA的收發(fā)器工具包支持，進一步提高收發(fā)器數(shù)據(jù)速率(對于Stratix V FPGA，高達14.1 Gbps)。

Altera公司產(chǎn)品和企業(yè)市場副總裁Vince Hu評論：“從設(shè)計規(guī)劃到編譯實施，Altera通過Quartus II軟件進一步簡化設(shè)計過程。采用我們的12.0版軟件，用戶可以充分發(fā)揮更快的編譯時間和擴展器件支持這些優(yōu)勢，滿足當(dāng)前的系統(tǒng)性能需求和效能要求，特 別是28-nm設(shè)計工程。”

Quartus II軟件簡介
 Altera的Quartus II軟件提供具有業(yè)界領(lǐng)先工具和功能的設(shè)計套裝，提高了FPGA設(shè)計人員的效能。設(shè)計環(huán)境提供前沿的綜合和布局布線算法，以及高級DSP設(shè)計和系統(tǒng)集成工 具，包括多種經(jīng)過預(yù)驗證的IP內(nèi)核等，支持FPGA設(shè)計人員滿足嚴格的產(chǎn)品及時面市目標。開發(fā)套裝支持所有的FPGA設(shè)計過程，從設(shè)計輸入，到時序收斂， 直至驗證。